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1.1. 编译概述
1.2. 使用Compilation Dashboard
1.3. 设计网表基础设施
1.4. 使用Node Finder
1.5. Precompiled Component (PCC)生成流程
1.6. Analysis & Elaboration流程
1.7. 设计综合
1.8. 设计布局和布线
1.9. 增量式优化流程
1.10. 快进编译流程(Fast-Forward Compilation Flow)
1.11. 完整编译流程(Full Compilation Flow)
1.12. 编译监控模式
1.13. 导出编译结果
1.14. 集成其他EDA工具
1.15. Compiler优化技术
1.16. 综合语言支持
1.17. 综合设置参考
1.18. Fitter设置参考
1.19. 设计编译修订历史
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1.16.1.4. 初始构造和存储器系统任务
Quartus® Prime软件根据Verilog HDL initial构造推断上电条件。 Quartus® Prime软件还为变量创建上电设置,包括RAM块。如果initial块中出现 Quartus® Prime软件无法综合的构造,则软件会生成错误。
为避免此类错误,请在translate_off和translate_on综合指令中附带不可综合的构造(例如仅用于仿真的构造)。初始构造合成使得已综合设计的上电状态与仿真中原始HDL代码的上电状态相匹配。
注: 初始块不会推断某些第三方EDA综合工具中的上电条件。如果需要在综合工具间进行转换,则必须正确设置上电条件。
Quartus® Prime综合支持$readmemb和$readmemh系统任务实现存储器初始化。
Verilog HDL代码:使用readmemb命令初始化RAM
reg [7:0] ram[0:15]; initial begin $readmemb("ram.txt", ram); end
创建用于存储器初始化的文本文件时,需在新指令行中使用格式@<location >指定地址,然后在下一行指定存储器字,如110101或abcde。
以下示例显示为RAM中存储器初始化文件(Memory Initialization File)(.mif)的一部分。
文本文件格式:使用readmemb命令初始化RAM
@0 00000000 @1 00000001 @2 00000010 … @e 00001110 @f 00001111