仅对英特尔可见 — GUID: ske1565895472842
Ixiasoft
1.1. 编译概述
1.2. 使用Compilation Dashboard
1.3. 设计网表基础设施
1.4. 使用Node Finder
1.5. Precompiled Component (PCC)生成流程
1.6. Analysis & Elaboration流程
1.7. 设计综合
1.8. 设计布局和布线
1.9. 增量式优化流程
1.10. 快进编译流程(Fast-Forward Compilation Flow)
1.11. 完整编译流程(Full Compilation Flow)
1.12. 编译监控模式
1.13. 导出编译结果
1.14. 集成其他EDA工具
1.15. Compiler优化技术
1.16. 综合语言支持
1.17. 综合设置参考
1.18. Fitter设置参考
1.19. 设计编译修订历史
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1.9.2.1.5. 通过Snapshot Viewer分析拥塞
- 要运行Fitter的Place或者Route阶段,请在Compilation Dashboard中双击相应的阶段。
- 该阶段完成后,在Compilation Dashboard中单击该阶段的Snapshot Viewer图标。Snapshot Viewer将打开。
- 在Analyze Congestion下,双击Show Logic Lock Regions with Congestion Heat Map。Chip Planner显示拥塞热图中的Logic Lock区域以供进一步分析。
图 92. 使用拥塞热图(Congestion Heat Map)显示逻辑锁定(Logic Lock)区域