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5.1. Cyclone® V器件中每个封装的I/O资源
5.2. Cyclone® V器件的I/O纵向移植
5.3. Cyclone® V器件中的I/O标准支持
5.4. Cyclone® V器件的I/O设计指南
5.5. Cyclone® V器件中I/O Bank的位置
5.6. Cyclone® V器件中的I/O Bank组
5.7. Cyclone® V器件中的I/O单元结构
5.8. Cyclone® V器件中的可编程IOE特性
5.9. Cyclone® V器件中的片上I/O匹配
5.10. Cyclone® V器件的外部I/O匹配
5.11. 专用高速电路
5.12. Cyclone® V器件中的差分发送器
5.13. Cyclone® V器件中的差分接收器
5.14. 源同步时序预算
5.15. Cyclone® V器件中的I/O特性修订历史
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5.14.1. 差分数据定向
外部时钟和输入数据之间存在一定关系。对于运行在840 Mbps和串化因子为10的操作,外部时钟以10倍增。您可以在PLL中设置相位对齐以符合每个数据位元的采样窗口。在倍增时钟的下降沿进行数据采样。
图 115. Intel® Quartus® Prime软件中的位定向(Bit Orientation)该图显示x10倍模式的数据位定向。