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4.1.3.3. Bitslip(位滑动)
使用bitslip电路以一个快速时钟周期的增量插入延迟,实现数据对齐。
rx_bitslip_ctrl信号每发起一个脉冲,数据滑动一个位。由于清除未定义的数据至少需要两个内核时钟周期,所以在检查数据是否对齐之前,必须等待至少4个内核时钟周期。
发送足够的bitslip信号翻转bitslip计数器后,rx_bitslip_max状态信号在4个内核时钟周期后被置位,标示bitslip计数器翻转点已达其最大计数值。