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4.1. 生成动态重配置设计和配置文件(Configuration Profile)
4.2. 动态重配置QSF设置
4.3. 动态重配置规则
4.4. 硬件状态和配置文件(Configuration Profile)
4.5. 基于 Nios II® 的动态重配置流程
4.6. 使用Tile Assignment Editor
4.7. 可视化动态重新配置组布局
4.8. 分配IP_COLOCATE层次结构
4.9. 示例:使用Multirate IP的动态重配置流程
4.10. 示例:动态重配置编程排序
4.11. 确定配置文件编号(Determining Profile Numbers)
6.1. 动态重配置新触发器
6.2. 动态重配置Next Profile 0
6.3. 动态重配置Next Profile 1
6.4. 动态重配置Next Profile 2
6.5. 动态重配置Next Profile 3
6.6. 动态重配置Next Profile 4
6.7. 动态重配置Next Profile 5
6.8. 动态重配置Next Profile 6
6.9. 动态重配置Next Profile 7
6.10. 动态重配置Next Profile 8
6.11. 动态重配置Next Profile 9
6.12. 动态重配置Next Profile 10
6.13. 动态重配置Next Profile 11
6.14. 动态重配置Next Profile 12
6.15. 动态重配置Next Profile 13
6.16. 动态重配置Next Profile 14
6.17. 动态重配置Next Profile 15
6.18. 动态重配置Next Profile 16
6.19. 动态重配置Next Profile 17
6.20. 动态重配置Next Profile 18
6.21. 动态重配置Next Profile 19
6.22. 动态重配置Avalon MM Timeout
6.23. 动态重配置TX通道重配置
6.24. 动态重配置RX通道重配置
6.25. 在复位确认(Reset Acknowledgment)中通道重配置TX通道
6.26. 退出复位状态的通道重配置TX通道
6.27. 动态重配置TX通道复位控制初始化状态
6.28. 动态重配置TX通道源警报(TX Channel Source Alarm)
6.29. 复位确认(Reset Acknowledgment)中的动态重配置RX通道
6.30. 退出复位状态的动态重配置RX通道
6.31. 动态重配置RX通道复位控制初始化状态
6.32. 动态重配置RX通道源警报(RX Channel Source Alarm)
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1.2. 设计考量
- 一个重配置仅在一个特定的拓扑结构中可用。在不同的拓扑结构中进行重配置是不受支持的。
- 一个重配置取决于F-Tile Architecture and PMA and FEC Direct PHY Intel® FPGA IP User Guide中指定的分裂规则(fracturing rule)。例如,您可以将一个200G fracture分成两个独立的100G fracture,等等。
- 所有切换都必须通过一个中性状态来完成,即置位数字数据路径复位并禁止PMA。
- 任何配置都支持SerDes速率重配置,前提是该速率对于一个给定的串化因子是合法的,并且与任何已使用的系统时钟是一致的。
- 无线IP的动态重配置以对称的方式应用于TX和RX数据路径。
- PMA-direct支持TX和RX数据路径之间相同的PMA宽度。然而,CPRI支持一个与32-bit PCS-direct宽度或者32-bit FEC+PCS-direct宽度相结合的20-bit PMA-direct宽度。
- 所有支持动态重配置的IP都必须适应F-tile系统时钟。您可以动态地重配置F-tile系统PLL,包括参考时钟管脚和频率。