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4.1. IP Catalog和Parameter Editor
4.2. Intel® FPGA IP核安装和许可
4.3. IP常规设置
4.4. 向IP Catalog添加自己的IP
4.5. Intel® FPGA IP的最佳实践
4.6. 生成IP Core ( Intel® Quartus® Prime Pro Edition)
4.7. 修改IP实例
4.8. 升级IP核
4.9. 仿真 Intel® FPGA IP核
4.10. 使用其他EDA工具综合IP核
4.11. 以HDL例化IP核
4.12. 支持IEEE 1735加密标准
4.13. Intel FPGA IP核介绍修订历史
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5.4.1.1. Verilog HDL配置例化
Intel® Quartus® Prime Pro Edition综合需要例化Verilog HDL配置,而非模块。 其他Quartus软件产品中,综合自动找到与您例化模块相关的Verilog HDL配置。随后,Verilog HDL配置例化设计。
如果您的顶层实体为Verilog HDL配置,则设置Verilog HDL配置,而非将模块设置为顶层实体。
其他Quartus软件产品 | Intel® Quartus® Prime Pro Edition |
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综合自动从Example RTL中找到与已例化模块相关的mid_config Verilog HDL配置。 | 综合不会从Example RTL中找到mid_config Verilog HDL配置。您必须直接例化Verilog HDL配置。 |
Example RTL:
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