DisplayPort Intel® Agilex™ F-Tile FPGA IP设计示例用户指南

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ID 709308
日期 12/13/2021
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1. DisplayPort Intel FPGA IP设计示例快速入门指南 2. 并行环回设计示例 3. DisplayPort Intel® Agilex™ F-tile FPGA IP设计示例用户指南文档修订历史
1. DisplayPort Intel FPGA IP设计示例快速入门指南 x
1.1. 目录结构 1.2. 硬件和软件要求 1.3. 生成设计 1.4. 仿真设计 1.5. 编译和仿真设计 1.6. DisplayPort Intel FPGA IP设计示例参数
2. 并行环回设计示例 x
2.1. Intel® Agilex™ F-tile DisplayPort SST并行环回设计特性 2.2. 时钟方案 2.3. 仿真测试台
1. DisplayPort Intel FPGA IP设计示例快速入门指南
2. 并行环回设计示例
3. DisplayPort Intel® Agilex™ F-tile FPGA IP设计示例用户指南文档修订历史

1.1. 目录结构

图 2. 目录结构
表 1.  设计示例组件
文件夹 文件
rtl/core dp_core.ip
dp_rx.ip
dp_tx.ip
rtl/rx_phy dp_gxb_rx/ ((DP PMA UX building block)
dp_rx_data_fifo.ip
rx_top_phy.sv
rtl/tx_phy dp_gxb_rx/ ((DP PMA UX building block)
dp_tx_data_fifo.ip
dp_tx_data_fifo.ip
二级标题