以太网设计实例组件用户指南

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ID 683044
日期 7/14/2020
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1. Time-of-day Clock 2. Time-of-day Synchronizer 3. Packet Classifier（包分类器） 4. 以太网设计实例组件用户指南存档 5. 以太网设计实例组件用户指南文档修订历史
1. Time-of-day Clock x
1.1. 发布信息 1.2. 资源利用率 1.3. 配置TOD Clock 1.4. 使用TOD Clock 1.5. 接口信号 1.6. 配置寄存器
1.4. 使用TOD Clock x
1.4.1. 调整TOD漂移 1.4.2. 调整偏移，抖动和漂移 1.4.3. 校正TOD偏移
1.5. 接口信号 x
1.5.1. Avalon存储器映射信号 1.5.2. Time-of-day信号
2. Time-of-day Synchronizer x
2.1. 发布信息 2.2. 资源利用率 2.3. 配置TOD Synchronizer 2.4. 使用TOD Synchronizer 2.5. 接口信号
2.4. 使用TOD Synchronizer x
2.4.1. 采样时钟频率
3. Packet Classifier（包分类器） x
3.1. 发布信息 3.2. 资源利用率 3.3. 配置Packet Classifier 3.4. 接口信号
3.4. 接口信号 x
3.4.1. 时钟和复位信号 3.4.2. Avalon® 流接口信号 3.4.3. 控制信号
1. Time-of-day Clock
2. Time-of-day Synchronizer
3. Packet Classifier（包分类器）
4. 以太网设计实例组件用户指南存档
5. 以太网设计实例组件用户指南文档修订历史

2.4. 使用TOD Synchronizer

图 2. 设计中的TOD Synchronizer

TOD Synchronizer使用“双时钟”（dual-clock）FIFO缓冲接收来自主TOD时钟的日时间（time of day）并将其传输至从TOD时钟。要确保准确同步，就必须考虑传输延迟。采样时钟（clk_sampling）采样FIFO缓冲区的填充水平并计算延迟。使用PLL从与主TOD时钟或从TOD时钟想通过的源获得该时钟信号。


本章节内容
采样时钟频率

二级标题